带VCC输入引脚的硅序列码芯片DS2411及其应用

文章摘要：图4 （３） 主机到从机的数据传输对于写１时隙来说，当写１为低的时间ｔＷ１ＬＭＡＸ结束以后，数据线上的电压必须超过阀值ＶＴＨＭＡＸ；对于写０时隙来说，当写０为低的时间ｔＷ０ＬＭＩＮ结束以前，数据线上的电压则必须保持在阀值ＶＴＨＭＩＮ以下；为了最大限度地保证通信的可靠性，数据线上的电压在整个ｔＷ０Ｌ持续时间内不能超过 ＶＩＬＭＡＸ。当数据线上电压超过阀值ＶＴＨＭＡＸ后，ＤＳ２４１１需要一个恢复时间ｔＲＥＣ以便准备下一个时隙。（４） 从机到主机的数据传输读数据时隙的起始部分与写１时隙类似。在读信号为低的时间ｔＲＬ结束以前，数据线上的电压必须保持在 ＶＴＬＭＩＮ 电压以下。在ｔＲＬ期间，如果应

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图4

（３） 主机到从机的数据传输

对于写１时隙来说，当写１为低的时间ｔＷ１ＬＭＡＸ结束以后，数据线上的电压必须超过阀值ＶＴＨＭＡＸ；对于写０时隙来说，当写０为低的时间ｔＷ０ＬＭＩＮ结束以前，数据线上的电压则必须保持在阀值ＶＴＨＭＩＮ以下；为了最大限度地保证通信的可靠性，数据线上的电压在整个ｔＷ０Ｌ持续时间内不能超过 ＶＩＬＭＡＸ。当数据线上电压超过阀值ＶＴＨＭＡＸ后，ＤＳ２４１１需要一个恢复时间ｔＲＥＣ以便准备下一个时隙。

（４） 从机到主机的数据传输

读数据时隙的起始部分与写１时隙类似。在读信号为低的时间ｔＲＬ结束以前，数据线上的电压必须保持在 ＶＴＬＭＩＮ 电压以下。在ｔＲＬ期间，如果应答信号为０，ＤＳ２４１１便开始将数据线拉低；终止该下拉和使电压再次升高的时间可由内部定时信号发生器来确定。而如果应答信号为１，则ＤＳ２４１１就不再需要将数据线拉低，总线电压会在ｔＲＬ结束后立即开始上升。

主机在数据线上执行一次读数采样所需的时间（ｔＭＳＲＭＡＸ到ｔＭＳＲＭＩＮ）一方面可由时序中的ｔＲＬ＋（上升时间）决定，另一方面可由ＤＳ２４１１内部的定时信号发生器决定。为了最大限度地保证通信的可靠性，ｔＲＬ的持续时间在允许的范围内应当尽可能的短一些，同时主机的读取时间也应尽量靠近ｔＭＳＲＭＡＸ但不能迟于ｔＭＳＲＭＡ。在从数据线上读数之后，主机还应当等到ｔＳＬＯＴ结束后才开始下一个动作，以保证ＤＳ２４１１有足够的恢复时间ｔＲＥＣ来准备下一个时隙。

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