基于CPLD和Embedded System的LED点阵显示

文章摘要：独立扫描模块的功能是以双口RAM 为中介将单片机送来的资料在LED 点阵显示屏上显示出来，其电路原理图如图3所示。单片机总线将处理好的待显示数据存放在U5(双口RAM IDT7132SA35JS中，然后U6(CPLD芯片ATF1508AS15JC84，用Verilog HDL语言编写其总线读逻辑)读取存放在U5中的待显示数据并驱动显示屏。整个显示屏为128×32点阵，一次扫描一个字节即8位，为此全屏显示需要128×32÷8=512字节。将地址线A9R、A10R 接地，这样只允许访问U5中的低512K 字节。 CA0~CA8是CPLD 输出到U5中的地址总线

基于CPLD和Embedded System的LED点阵显示,标签：电路设计,http://www.88dzw.com

独立扫描模块的功能是以双口RAM 为中介将单片机送来的资料在LED 点阵显示屏上显示出来，其电路原理图如图3所示。单片机总线将处理好的待显示数据存放在U5(双口RAM IDT7132SA35JS中，然后U6(CPLD芯片ATF1508AS15JC84，用Verilog HDL语言编写其总线读逻辑)读取存放在U5中的待显示数据并驱动显示屏。整个显示屏为128×32点阵，一次扫描一个字节即8位，为此全屏显示需要128×32÷8=512字节。将地址线A9R、A10R 接地，这样只允许访问U5中的低512K 字节。 CA0~CA8是CPLD 输出到U5中的地址总线，CD0~CD7是从U5读出数据的数据总线。 J1是行扫描信号接口，CH0~CH4 为行扫描计数器输出信号，时钟信号可从CLK 输出给行扫描计数器。 J2为列扫描控制信号V0~V7输出接口。 DR0~DR15为一色的列选通控制信号输出，由于I/O端口引脚不够，所以另一色的列选通信号采用译码电路译码输出，用J3的四线输出。 CON1为JTAG 接口，J6为时钟源选择接口，可接单片机的ALE信号，也可接有源晶振CR2的输出。有源晶振CR2相当于一信号产生电路，只要其2脚接地，4脚接电源，3脚就有额定的输出波形。

由于采用CPLD 设计扫描逻辑，所以扫描逻辑的关键不再取决于硬件连接，而是取决于芯片的设计。

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