用CPLD实现DSP与PLX9054之间的连接

文章摘要：对于其它一些控制信号（如高低字节标志信号ＨＨＷＩＬ），由于它们是随着ＨＳＴＲＯＢＥ上升沿的出现不断产生０和１的交替变化，所以，可用ＨＤＳ２作为时钟输入的两分频电路来产生ＨＨＷＩＬ；而ｌｏｃａｌ ｂｕｓ申请应答信号ＬＨＯＬＤＡ，则可由ＬＨＯＬＤ信号经一个ＬＣＬＫ的延迟后输出产生；ＨＣＮＴＬ[０：１]接两根地址线，以便由上层驱动程序来控制对ＨＰＩ口内部不同寄存器的访问，并由ＬＷ／ Ｒ接反相器来产生Ｒ／ Ｗ信号。其原理图如图４所示。 ３结束语 本文提供的这种设计方法经过实际运行检验，可以保证ＰＬＸ９０５４和ＤＳＰ之间的可靠连接，且逻辑关系简单。由于数据线可以完全独立于ＣＰＬＤ之外直接连接，可有效节约

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对于其它一些控制信号（如高低字节标志信号ＨＨＷＩＬ），由于它们是随着ＨＳＴＲＯＢＥ上升沿的出现不断产生０和１的交替变化，所以，可用ＨＤＳ２作为时钟输入的两分频电路来产生ＨＨＷＩＬ；而ｌｏｃａｌ ｂｕｓ申请应答信号ＬＨＯＬＤＡ，则可由ＬＨＯＬＤ信号经一个ＬＣＬＫ的延迟后输出产生；ＨＣＮＴＬ[０：１]接两根地址线，以便由上层驱动程序来控制对ＨＰＩ口内部不同寄存器的访问，并由ＬＷ／ Ｒ接反相器来产生Ｒ／ Ｗ信号。其原理图如图４所示。

３　结束语

本文提供的这种设计方法经过实际运行检验，可以保证ＰＬＸ９０５４和ＤＳＰ之间的可靠连接，且逻辑关系简单。由于数据线可以完全独立于ＣＰＬＤ之外直接连接，可有效节约成本，因而具有较高的实用价值和经济价值。

 

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